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关于阻抗的话题已经说了这么多，想必大家对于阻抗控制在pcb layout中的重要性已经有了一定的了解。俗话说的好，工欲善其事，必先利其器。要想板子利索的跑起来，传输线的阻抗计算肯定不能等闲而视之。
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在高速设计流程里，叠层设计和阻抗计算就是万里长征的第一步。阻抗计算方法很成熟，所以不同的软件计算的差别很小，本文采用Si9000来举例。
& }. Y( Q4 ]2 X% P/ T 图1
/ I: i& X) ?8 h! @阻抗的计算是相对比较繁琐的，但我们可以总结一些经验值帮助提高计算效率。对于常用的FR4，50ohm的微带线，线宽一般等于介质厚度的2倍；50ohm 的带状线，线宽等于两平面间介质总厚度的二分之一，这可以帮我们快速锁定线宽范围，注意一般计算出来的线宽比该值小些。
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9 ^) w; Z2 T/ [ z/ n& g5 U除了提升计算效率，我们还要提高计算精度。大家是不是经常遇到自己算的阻抗和板厂算的不一致呢？有人会说这有什么关系，直接让板厂调啊。但会不会有板厂调不了，让你放松阻抗管控的情况呢？要做好产品还是一切尽在自己的掌握比较好。0 r" \$ M: E4 c! ?* e; F, q
" L- s. V, y1 B; X9 s" r$ @以下提出几点设计叠层算阻抗时的注意事项供大家参考：
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1，线宽宁愿宽，不要细。这是什么意思呢？因为我们知道制程里存在细的极限，宽是没有极限的。如果到时候为了调阻抗把线宽调细而碰到极限时那就麻烦了，要么增加成本，要么放松阻抗管控。所以在计算时相对宽就意味着目标阻抗稍微偏低，比如单线阻抗50ohm，我们算到49ohm就可以了，尽量不要算到51ohm。, H+ [# \7 j& T7 f
& \# r0 c% ], g3 a# j8 f2，整体呈现一个趋势。我们的设计中可能有多个阻抗管控目标，那么就整体偏大或偏小，不要100ohm的偏大，90ohm的偏小。
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+ _' Z! j7 Z/ T3，考虑残铜率和流胶量。当半固化片一边或两边是蚀刻线路时，压合过程中胶会去填补蚀刻的空隙处，这样两层间的胶厚度时间会减小，残铜率越小，填的越多，剩下的越少。所以如果你需要的两层间半固化片厚度是5mil，要根据残铜率选择稍厚的半固化片。% V! }: ^0 j" z/ T
# g0 k$ t' {1 T9 O) {# ]/ J4，指定玻布和含胶量。看过板材datasheet的工程师都知道不同的玻布，不同的含胶量的半固化片或芯板的介电系数是不同的，即使是差不多高度的也可能是3.5和4的差别，这个差别可以引起单线阻抗3ohm左右的变化。另外玻纤效应和玻布开窗大小密切相关，如果你是10Gbps或更高速的设计，而你的叠层又没有指定材料，板厂用了单张1080的材料，那就可能出现信号完整性问题。2 o6 P4 q. b2 O' t& D) i; F; f- X
5 v3 ~1 w L2 [. U; O( O当然残铜率流胶量计算不准，新材料的介电系数有时和标称不一致，有的玻布板厂没有备料等等都会造成设计的叠层实现不了或交期延后。咋办？最好的办法就是在设计之初让板厂按我们的要求，他们的经验设计个叠层，这样最多几个来回就能得到理想又可实现的叠层了。
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$ h [* s" w: q. R! J' ~作者： 一博科技. t1 O7 P' G2 f z/ I+ L
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