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[作业已审核] 7.弟子计划+唐磊+百兆网口模块+第7次作业

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发表于 2020-11-24 19:53:59 | 显示全部楼层 |阅读模式
百兆网口
   1.变压器与网口部分靠近(5inh以内)
   2.CPU与PHY芯片之间走线尽量短
   3.时钟电路尽可能靠近PHY芯片,使时钟走线尽可能短,时钟电路远离板边与高频信号
   4.复位电路尽可能远离RX,TX(信号接收传送),尽可能靠近PHY芯片
   5.交流端接电阻先按照芯片资料的布局进行摆放,若没有,一般情况下靠近以太网转换芯片摆放
   6.TX+,TX-和RX+,RX-尽量走在表层,这两组差分对之间的间距至少4w以上,对内等长约束5mil,,两组差分对之间不用等长
   7.LED信号(#9-#12管脚)要加粗到10mil以上#4-#5管脚也要加粗到10-20mil
   8.变压器下面所有层都要进行挖空处理(沿着丝印框本体挖空)
   9.外壳地与GND之间的桥接电容要靠近外壳地放置,且走线加粗处理(10-20mil)
   10.变压器布线-除差分信号外,其他信号要加粗到20mil以上。

7.弟子计划+唐磊+百兆网口模块+第7次作业.zip

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发表于 2020-11-27 17:04:02 | 显示全部楼层
百兆网口模块已经评审完毕,请查看附件中的评审报告!

AD弟子计划百兆网口华评审报告20201127.doc

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