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[文件已评审] AD 2层 BOSCH_ZIGBEE板评审报告20190213

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发表于 2019-2-16 16:48:31 | 显示全部楼层 |阅读模式
您阅读的评审报告自于凡亿PCB QA评审组(www.fany-online.com) ( p8 O, v7 ?$ }) K* ~" b. I
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1.评审PCB全程保密不外发,评审之后会进行文件删除,介意者不要发送文档!, D( i* |- o5 P/ G( \0 `% [
/ T. U$ i5 s  ?; I+ G2.评审报告只是局部截图并添加文字说明,如需更详细的请内容请联系我们评审人员" T* X  B, v) Z7 a/ X7 B
3.评审意见仅供参考意见,由此造成的任何相关损失网站概不负责# A* M) Z6 g3 M3 u) I4 v3 E' ?1 Q7 C2 s
: ~! _0 t' d4 i2 D------------------------------------------------------------------------------------$ n9 ]! ?4 t# c" ?, f8 e& P
一.布局问题:7 o# {$ _2 j* y8 c+ w
1.【问题分析】:通过丝印不难看出,器件挨的太近,这样不利于器件的焊接。7 g2 Q; Y, \) p3 y
【问题改善建议】:板子整体的空间是比较大的,可以将器件的间距拉开些。+ o; F+ \5 q$ }5 G3 q, Q1 i  ]

" r; P9 c$ p* p% ]' M2 j2 N& O2.【问题分析】:滤波电容的摆放存在问题,有的离管脚太远或者没在管脚边;这样不能很好的起到滤波作用。
0 @: U4 L9 a- E% b3 p【问题改善建议】:滤波电容靠近对应的管脚摆放,对于CPU上的多个管脚,尽量保证,一个管脚一个对应的滤波电容。
) H' W/ g! ^2 t" a! Q6 }* T+ Z4 I- f
+ W  T" q2 g* h3 ], X* @! t: p" ]. h二.布线问题:
/ f( Z! N4 T9 C+ K! W1.【问题分析】:差分USART的走线存在问题,单根换层走线,这样会影响差分的信号。
: \8 j8 H& Y* e( w3 A. N2 N【问题改善建议】:差分走线同组同层,换层的话,两根一起换层走线。
5 Q8 R7 K& m: r; a$ N& ^
3 ^6 @+ m2 t. C  d2 A2.【问题分析】:时钟线能一次拉直的情况下,板中却转了个弯。5 w) |# W; G1 R8 {& ]; c
【问题改善建议】:信号线能拉直就拉直,多转弯容易产生不良反射影响信号。且时钟线建议包地处理;不包地就保证他和其他信号线之间有足够的间距。
- R9 N+ k' ?& x2 [( O! R5 c1 b8 x& {* p, A
3.【问题分析】:板中类似此种的尖角铜和孤岛铜没有割掉。尖角铜皮会对信号产生折射,孤岛铜皮在生产时容易掉落或翘起,对板子造成不良影响。1 R/ N, B: F( ?
【问题改善建议】:建议细致检查下铜皮,放置cutout对孤岛铜和尖角铜进行割掉处理。! ^& }2 a$ I3 S) q8 A3 ?1 ~, d5 W

+ ?- r6 A' |# E' C$ o/ r4 T' j4.【问题分析】:PCB中的过孔感觉打的比较乱,板子密度不大的情况无影响,但对于密度大的板子来说,杂乱的打孔会严重的影响后期的扇孔布线。
8 X- p* \. Y& t; Z* Y' g【问题改善建议】:建议打孔走线时多使用等间距及对齐命令,养成好习惯。
- q7 C; c4 k1 _3 E/ k1 |! m8 t+ _) y; s0 @% t( j

. R  g- @, a. s# Y& I' H

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发表于 2019-2-17 16:35:04 | 显示全部楼层
学习学习,
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发表于 2019-2-19 16:19:53 | 显示全部楼层
你好,学习了,但是最后一个问题过孔杂乱是何含义,不是很理解,可以进一步说明吗?
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发表于 2019-8-7 14:40:40 | 显示全部楼层
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