AD 4层pcb板 PCB论坛公益评审报告：20181113

凡亿刘老师

您阅读的评审报告自于凡亿PCB QA评审组(www.fany-online.com) / I& K; l6 ?6 I; C  K1 [
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7 p- }# k7 S% N: _- F* y/ F; A8 a如果您的PCB需要评审，请以邮件的方式发送给我们，我们一般在1个工作日之内安排评审; }% T8 {% e, w( t) _& y
. j! K; ^1 }% C% [4 r7 [9 o邮件格式：PCB公益评审+项目名称
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[size=12.0000pt]1. [size=12.0000pt]过孔没盖油，建议进行盖油处理。
   

[size=12.0000pt]2. [size=12.0000pt]DRC检查，存在错误。违反了电源层的连接规则。（可能是AD版本不同导致规则没有导过来，但还是建议检查下。）
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( v, ]; }+ [" M: _* T) \9 D: r, }0 m) x
[size=12.0000pt]3.类似于此种孤岛铜和尖角铜，建议割掉。电容电阻中的铜也要割掉。

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[size=12.0000pt]4.电源的分割线一般用15mil的。图中的分割存在瓶颈，中间的太窄了。

7 z* l1 E, D/ s6 I* s[size=12.0000pt]5. [size=12.0000pt]过孔的间距太小，造成平面割裂了。建议拉大间距，或者修改规则。
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7 I7 L* E% X, _% d8 e7 l[size=12.0000pt]6.出线建议从焊盘中心出。

[size=12.0000pt]7.线宽不能超过焊盘，建议引出后加粗。
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* k- U, }3 K) }: @[size=12.0000pt]8.焊盘间不要这样连接，影响工艺。
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[size=12.0000pt]9. [size=12.0000pt]走线时，不要出现直角和锐角。
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+ }0 }; @% l5 a4 K5 W[size=12.0000pt]10. [size=12.0000pt]UDB此对信号应为差分信号。

( `5 C) E, m* {, Y4 b( e$ \2 `[size=12.0000pt]11. [size=12.0000pt]X2是晶振，走线要考虑π型滤波，包地，且下方不能穿线。

0 a2 E4 ^, O" _. W. A[size=12.0000pt]12. [size=12.0000pt]CPU中不建议这样穿线，影响工艺，地孔可打孔通过地铜连接。
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% k- Q5 z* a" n9 `  F2 {3 u[size=12.0000pt]13. [size=12.0000pt]走线时，能拉直尽量拉直。

, O. v6 j" @1 Y4 |& v[size=12.0000pt]14. [size=12.0000pt]电源的处理。
[size=12.0000pt]电源的处理参考经验值0.5mm的过孔过1A。表层的线是40mil过1A（表层递增加20，内层递增加40 。不是绝对值，通常做好1A的预留）。检查电源的过孔数量是否足够，线宽是否满足需要。
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zhidai

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