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[作业已审核] 郑永举——两片DDR的PCB布局布线设计作业

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发表于 2025-6-3 14:57:53 | 显示全部楼层 |阅读模式
布局上

1、DDR以CPU中心点对称摆放呈T字型
2、DDR与DDR之间中心间距小于1280mil
3、DDR与CPU最近焊盘距离控制在600~800mil,当中间有排阻时控制在800~1000mil
布线上
1、数据线每11根为一组(D0~D7、DQM0、DQS0_N、DQS0_P)(D8~D16、DQM1、DQS1_N、DQS1_P)以此类推
2、其他地址线为一组
3、数据线最大长度不超过2500mil,误差控制在±25mil,地址线误差控制在±100mil

DDR2.brd

1.51 MB, 下载次数: 1, 下载积分: 联盟币 -5

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发表于 2025-6-4 10:17:34 | 显示全部楼层
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