【科普】PECL/CML/LVDS高速差分接口原理

硬件电子工程师

【摘要】PECL/CML/LVDS这几种高速差分接口是我们工程中常用接口，本文将从接口起源、输出内部结构、输入内部接口三方面分别阐述各自原理。下一篇文章将重点阐述这几种高速接口之间的互联硬件设计。

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0 M1 {( ^5 n  [9 x' A1. 差分信号接口介绍1.1 PECL 接口PEL 是有 ECL 标准发展而来，在 PECL 电路中省去了负电源，较 ECL 电路更方便使用。PECL 信号的摆幅相对 ECL 要小，这使得该逻辑更适合于高速数据的串性或并行连接。PECL 标准最初有 MOTOROLA 公司提出，经过很长一段时间才在电子工业界推广开。
1 m' B/ c: u2 u' O

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' X# r9 ?  J* r3 F" Z （1）PECL 接口输出结构PECL 电路的输出结构如图 1 所示，包含一个差分对和一对射随器。输出射随器工作在正电源范围内，其电流始终存在，这样有利于提高开关速度。标准的输出负载是接 50Ω至 VCC-2V 的电平上，如图 1 中所示，在这种负载条件下，OUT+与 OUT-的静态电平典型值为 VCC-1.3V， OUT+与OUT-输出电流为 14mA。PECL 结构的输出阻抗很低，典型值为 4~ 5 Ω，这表明它有很强的驱动能力，但当负载与 PECL 的输出端之间有一段传输线时，低的阻抗造成的失配将导致信号时域波形的振铃现象。
( u6 U% o7 p5 c: W

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5 S# K+ s6 V# U. e图1. PECL 输出结构
* p6 @; h- g" ~- b3 `（2） PECL 接口输入结构PECL 输入结构如图 2 所示，它是一个具有高输入阻抗的差分对。该差分对共模输入电压需偏置到 VCC-1.3V，这样允许的输入信号电平动态最大。MAXIM 公司的 PECL 接口有两种形式的输入结构，一种是在芯片上已加有偏置电路，如 MAX3867、MAX3675，另一种则需要外加直流偏置。
( u6 W5 T1 j0 N5 ]- V

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# s4 T" F8 o" U$ P  ]/ E图2. PECL 输入电路结构
& Q4 ]+ @4 d  N6 }! ~: [表一中给出了 MAXIM 公司 PECL 接口输入输出的具体电气指标。
表格1. PECL 输入输出指标
# H6 C! s( c0 D

参数 1 D( n- y# R5 R' T3 A0 p2 I$ B# }	条件	最小值	典型值	最大值 / F; i! o3 a, N4 K4 d! a	单位 6 Q, g& \/ v0 B4 N) P* M
输出高电平 4 \" g- c1 |6 {0 ^# I* c2 ~8 G	Ta=0℃~85℃	Vcc-1.025   O. O7 f& o7 w: F' L		Vcc-0.88	V
Ta=-40℃	Vcc-1.085 , x/ `3 ]5 J6 k, p, K3 l		Vcc-0.88	V
输出低电平	Ta=0℃~85℃	Vcc-1.81 , A: D( H% l2 Q9 F9 E	/ p8 R: x' Z( v- a! H3 z	Vcc-1.62	V 6 |( a) N! _- v8 O; A3 K8 k
Ta=-40℃ 5 a) J% L, J9 \, A! M) Y	Vcc-1.83		Vcc-1.55	V
输入高电平	* m4 `* e2 _8 O# q: ]4 t	Vcc-1.16 4 }. R  l2 h- n% B( q		Vcc-0.88	V 2 B/ n; p# f3 a( H. R1 C' O$ O
输入低电平 ; B* Q. d7 l3 |; u# C3 S6 J! x" s	# M( K1 D: o0 H5 v( \# H' ^	Vcc-1.81 $ ^3 F' O# g9 c		Vcc-1.48	V , j3 t2 c2 ?% X! W7 j% D

在5V 和3.3V 供电系统中，PECL 接口均适用，3.3V 供电系统中的PECL 常被称作低压PECL，简写为 LVPECL。
. U( C# f/ C! `& ~' N+ R在使用 PECL 电路时要注意加电源去耦电路，以免受噪声的干扰，同时输出采用交流还是直流耦合对负载网络的形式将会提出不同的需求。

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1.2 CML 接口CML 是所有高速数据接口形式中最简单的一种，它的输入与输出是匹配好的，从而减少了外围器件，也更适合于在高的频段工作。它所提供的信号摆幅较小，从而功耗更低。
（1）CML 接口输出结构CML 接口的输出电路形式是一个差分对，该差分对的集电极电阻为 50Ω，如图 3 中所示， 输出信号的高低电平切换是靠共发射极差分对的开关控制的，差分对的发射极到地的恒流源典型值为 16mA，假定 CML 输出负载为一 50Ω上拉电阻，则单端 CML 输出信号的摆幅为Vcc~Vcc-0.4V。在这种情况下，差分输出信号摆幅为 800mV，共模电压为 Vcc-0.2V。若 CML
6 T- V. |1 C  F, k* z: _4 Q( G& F# I输出采用交流耦合至 50Ω负载，这时的直流阻抗有集电极电阻决定，为 50Ω，CML 输出共模电压变为 Vcc-0.4V，差分信号摆幅仍为 800mV。在交流和直流耦合情况下输出波形见图 4。
$ W3 V" f1 u5 [* I6 e& m

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- @0 B8 X& U4 b1 t8 f图3. CML 输出结构

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图4. CML 在不同负载时的输出波形

（2）CML 接口输入结构
0 A8 d1 l0 {9 R7 E

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图5. CML 输入电路结构
3 _# U8 F" q' D7 T表二以 MAX3831、MAX3832 为例列出了 CML 器件的输入输出技术参数
表格2. CML 输入和输出参数
" [$ m9 c/ t" y( B7 @* {

参数 , W* q8 \! e  e' a	条件 ) i8 k. L1 F& V4 R$ Z7 d% g	最小	典型	最大 # \& ?+ D' z% `, ]: }	单位 6 P5 X6 ]- q, ]" ]' M8 {
差分输入电压 : j6 B% o, g' C# p- R: i" K		640 # A) h0 F% T; C) {. {	800	1000	mV , J! j# W& l6 `! J3 E2 _
输出共模电压 + Q7 W1 {7 w4 {' h* a5 v	0 V% L/ P5 E- S		Vcc-0.2		V
单端输入电压范围 : d/ X0 ^4 W  \7 p1 @& M) @# o	VIS ' T6 f4 }$ H: j  Z, E* T	Vcc-0.6 9 H2 c3 }4 U) c/ P	! K+ A% U1 K6 X+ O3 L2 V	Vcc+0.2 6 ^; q4 F" h& L6 i! i	V
差分输入电压摆幅 + h7 C# e2 x, E5 y& c" v) U	8 w' s8 U$ D1 C' p2 J	400 + ^3 H: n$ T0 T( k		1000 ' p5 M6 F7 [. Y4 D" |9 h! z	MVp-p / k& }* H" [8 |' @' ?2 i

注：MAXIM 不同产品 CML 输入灵敏度不同，如 MAX3875、MAX3876。
! W+ E0 R" L9 F+ }& u' i" {. d1.3 LVDS 接口LVDS 用于低压差分信号点到点的传输，该方式有三大优点，从而使得它更具有吸引力：
8 y) ?- v7 }9 x1 F6 `' G1)  LVDS 传输的信号摆幅小，从而功耗低，一般差分线上电流不超过 4mA，负载阻抗为 100Ω。这一特征使它适合做并行数据传输。
9 G+ O, y1 S; J7 v! }/ s2)  LVDS 信号摆幅小，从而使得该结构可以在 2.4V 的低电压下工作。
3) LVDS 输入单端信号电压可以从 0V 到 2.4V 变化，单端信号摆幅为 400mV，这样允许输入共模电压从 0.2V 到 2.2V 范围内变化，也就是说 LVDS 允许收发两端地电势有±1V 的落差。

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  U, r, t* w2 |% k（1）LVDS 接口输出结构MAXIM 公司 LVDS 输出结构在低功耗和速度方面做了优化，电路如图 6 所示。电路差分输出阻抗为 100Ω，表三列出了其他一些指标。
3 |. h* l0 P+ v

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7 m; s& \7 i2 y# l* z' @+ P图6. LVDS 输出结构
* E* [4 ]) U( k7 n/ z$ k' f（2）LVDS 接口输入结构LVDS 输入结构如图 7 所示，输入差分阻抗为 100Ω，为适应共模电压宽范围内的变化， 输入级还包括一个自动电平调整电路，该电路将共模电压调整为一固定值，该电路后面是一个 SCHMITT 触发器。SCHMITT 触发器为防止不稳定，设计有一定的回滞特性，SCHIMTT 后级是差分放大器。
5 p0 o; W$ Z4 D/ G

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图7. LVDS 输入结构
表三总结了 MAXIM 公司 LVDS 输入与输出技术指标（MAX3831，MAX3832，MAX3880，MAX3890，MAX3885）
表格3. LVDS 输入与输出参数

参数 & n+ n8 p% S0 U- x0 L	符号	条件 2 R# a& K5 {% F+ _	最小	典型 - K0 t; p+ z4 G& [, A. H	最大 8 L, ~1 b! |6 c% c6 x1 U8 M	单位
LVDS 输出高电压 1 _* d8 M) U) l2 T	VOH	% \- I& l5 l' G$ p) {		1 w) l: v: M& z- C' R2 D4 s# d) Q# s	1.475 * f& j# x2 H+ j1 e, R& a) d	V , {+ s6 H+ g; f5 ]$ k5 `$ n. T+ [
LVDS 输出低电压 8 {, _% k9 S3 y8 s2 j	VOL		0.925			V ! l3 H% z: l3 p' _; N
LVDS 输出差分电压   ^' D% W" M* ]. k5 y6 o0 f( V	|VOd|	, U+ j( X; z# W% ]; s* M9 p4 t3 [	250 + {: b6 Q) r# R: j- s% Z0 E	: i  D4 c) v( @. u% v	400	mV
LVDS 在不同状态时 输出差分电压波动	Δ|VOd|	. i+ r( J/ E7 g	7 h$ m, R6 ~, n& h5 x0 x	+ w, n" n$ w/ Y- x	25 + n- h* z2 y7 t4 W1 u	mV
LVDS 输出电压偏移量			1.125		1.275	V / y9 r/ g6 ]  _
LVDS 在不同状态时 8 k% V" h& Y5 m输出电压偏移量波动 / C! a" c: P! `8 [  x" o	Δ|VOs| . G3 L" O7 o) Y; D9 {	0 a; [- x( k0 F5 @' r- I+ H	' [. e8 w# q1 i. ~$ }	# s0 C0 }5 p9 P. T1 \4 N	25 # y2 z! r9 T+ P) s/ j+ T- A! ~	mV
LVDS 输出差分阻抗 3 H3 a. E" p1 ^; v1 L$ ^% g	5 h) _3 D7 s& l: X8 ~2 e; N	* f! `* x5 X& ^  O) T' ]3 c	80 6 q- n+ }9 S0 j/ g4 w/ q		120 ; S( p! I) |, G3 h; c& O' H	Ω 1 Y6 V5 j: n3 ?6 a! u
LVDS 输出电流		两差分端相接		, l( X% H5 Q. X2 |5 q- n/ I	12 & e; i7 G% y* Z* f$ ~% S	mA ) H. }0 J1 X* w$ t) z3 H# w
) {( R4 Q" q  R' U- o	差分单端到地短路 ! K) e% O5 g' }$ W* [	# G/ m* Y% q+ U+ ]" w	; P6 [1 Y4 {+ `8 q9 U3 F	40	mA
LVDS 输入单端电压范围	Vi	6 f8 M1 a6 p9 ^' {. J# M) ?. l9 h4 E	0 % }' b$ n2 m2 o0 c  `: H) W$ W  Y		2.4	V & L8 M/ t9 m% S. p5 h
LVDS 输入差分信号灵敏度 & y( j! J- w/ q. V	|Vid| 1 u2 A4 S* S  W2 D, l. U& A	" m* b: V" I' Y3 v) j( u' G& F	100			mV " `6 b  t  z8 i* ]
LVDS 输入共模电流 5 u  {/ T3 y$ b  M6 }& a4 k0 s$ @- n		VOS = 1.2V 时		350	+ X" j: z/ O, I# c  K	μA
LVDS 回滞门限宽度 9 R& U9 b" L' t+ K! k" \& j		8 y9 |" Y% I- D' v  v		70 ) P/ d4 i4 S0 Y7 b# A; V  k9 ]	# @2 S9 m" x& a. r, \: C! q	mV
LVDS 输入差分阻抗 ' h, A, n2 [' P; b	Rin		85	100	115 1 A9 X$ h& i* }- E	Ω 5 a9 E' G8 I; U; w/ i

由于差分线信号变化连续，差分摆幅小，使之在传输速率的提高以及辐射发射的降低上，相对于传统的TTL以及CMOS等开关量信号有较大的优势,因此高速信号一般采用差分的方式进行传输。目前主要的差分信号电平有LVPECL，LVDS，CML等类型。下篇将对上述各种差分电平的互联电路设计，包括耦合方式、电路参数选择以及设计原则等，进行描述。