|
现象一:这板子的pcb设计要求不高,就用细一点的线,自动布吧" V' A" K& e( \9 e4 L9 B
点评:自动布线必然要占用更大的PCB面积,同时产生比手动布线多好多倍的过孔,在批量很大的产品中,PCB厂家降价所考虑的因素除了商务因素外,就是线宽和过孔数量,它们分别影响到PCB的成品率和钻头的消耗数量,节约了供应商的成本,也就给降价找到了理由。
! X6 ` w( e$ F! H6 G5 B; I; y8 ~$ i$ _( `) M
现象二:这些总线信号都用电阻拉一下,感觉放心些。$ q; A# M+ _/ V# r$ |
点评:信号需要上下拉的原因很多,但也不是个个都要拉。上下拉电阻拉一个单纯的输入信号,电流也就几十微安以下,但拉一个被驱动了的信号,其电流将 达毫安级,现在的系统常常是地址数据各32位,可能还有244/245隔离后的总线及其它信号,都上拉的话,几瓦的功耗就耗在这些电阻上了。
& l$ Y+ H- }# X4 T1 i, a5 M5 }3 e
0 L$ U {$ \( d2 N& j* k+ u4 W现象三:CPU和FPGA的这些不用的I/O口怎么处理呢?先让它空着吧,以后再说。
# _+ I& w8 T X* X) D P# Z点评:不用的I/O口如果悬空的话,受外界的一点点干扰就可能成为反复振荡的输入信号了,而MOS器件的功耗基本取决于门电路的翻转次数。如果把它上拉的话,每个引脚也会有微安级的电流,所以最好的办法是设成输出(当然外面不能接其它有驱动的信号)
. N' q/ X. ]1 M' H0 w, N" `8 J
3 f- F7 x& Z8 }) m! {; L* W# {现象四:这款FPGA还剩这么多门用不完,可尽情发挥吧: c$ r) A3 A$ V
点评:FGPA的功耗与被使用的触发器数量及其翻转次数成正比,所以同一型号的FPGA在不同电路不同时刻的功耗可能相差100倍。尽量减少高速翻转的触发器数量是降低FPGA功耗的根本方法。
F! K: d8 {$ w% l! e$ W& D' l1 U! W% e
现象五:这些小芯片的功耗都很低,不用考虑; R5 Z! L8 U( H- ^& v& X
点评:对于内部不太复杂的芯片功耗是很难确定的,它主要由引脚上的电流确定,一个ABT16244,没有负载的话耗电大概不到1毫安,但它的指标是 每个脚可驱动60毫安的负载(如匹配几十欧姆的电阻),即满负荷的功耗最大可达60*16=960mA,当然只是电源电流这么大,热量都落到负载身上了。
$ m+ Q) B! U/ k1 S* F- T% e) N/ Y更多精彩内容可关注于博士信号完整新微信公众号(zdcx007)1 E9 r' m; V7 V) d
2 o& C8 ?: e( q) n5 R: z
信号完整性设计及仿真和高速PCB设计及故障整改,以及一些小的问题可咨询于博士信号完整性网站(sig007)2 l. d0 B0 I h3 _1 O4 b1 u
3 p% ]( O0 `: b) C+ b
|
|