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[作业已审核] 袁鹏——第二十一次作业-DDR-T模块

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发表于 2024-2-23 22:35:45 | 显示全部楼层 |阅读模式
本帖最后由 cesc 于 2024-3-1 10:18 编辑

熟悉ddr-t模块布局布线

DDRT1.brd

1.57 MB, 下载次数: 2, 下载积分: 联盟币 -5

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发表于 2024-3-1 10:14:37 | 显示全部楼层
DDR颗粒与CPU距离太远了,实际项目中不会这么多空间给你放置,一般推荐800mil左右


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发表于 2024-3-1 10:15:39 | 显示全部楼层
滤波电容尽量放在背面靠近管脚


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发表于 2024-3-1 10:17:19 | 显示全部楼层
这里的走线是不是可以优化出3W间距呢


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发表于 2024-3-1 10:18:12 | 显示全部楼层
vref可以优化到内层走线,更美观


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