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[文件已评审] AD 4层采集器 PCB论坛公益评审报告:20181120

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发表于 2018-11-20 16:07:35 | 显示全部楼层 |阅读模式
[size=12.0000pt]1过孔开窗了,建议进行盖油处理。
" V; W: v2 y5 Q4 ]( V4 w9 o* A6 f& K# D" \0 m
[size=12.0000pt]2. [size=12.0000pt]DRC检查,存在报错。热焊盘设计不符合设置规则,会影响焊接。需要调整设计规则或更改设计。. N. c/ O4 i, D* d) x8 u1 q
, Y/ l$ e- I, A2 Z
[size=12.0000pt]3. [size=12.0000pt]尖角铜皮,孤岛铜皮和电容电阻器件间的铜皮,建议割掉。
& B) ^" P3 c8 o/ e0 k5 V! f
; J! y/ h( Q) I& x[size=12.0000pt]4.AGND顶底层的铜皮没区分开来,与PGND一样,可以在顶底层连接,地层尽量保持完整性。8 s4 I% M( e! `2 E0 n

, h! w7 [/ q$ `) L[size=12.0000pt]5.电源层割裂严重,且出现瓶颈。建议小电源顶底层处理,大电源电源层处理,保持平面完整。
' H' \' Q  s2 y, O
. M  r' m0 ]0 ~& m: _# H& w  w& Y" @! I/ T9 Y2 M% t! y

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发表于 2018-11-20 16:09:04 | 显示全部楼层
[size=12.0000pt]6.这块是不是高压部分,如果是的话,不要铺铜。; V# q( K5 j  z' k: _3 Z

+ j$ W% V0 L. u" A[size=12.0000pt]7.晶振与其电容要同层放置,且考虑π型滤波。靠近管脚摆放,下方不能过线。" o& e7 k  s1 [6 Q& M( {9 ^1 X

& p" `8 w9 K- l. W0 ~7 U- @[size=12.0000pt]8. [size=12.0000pt]线能拉直的就拉直,且不要存在stub线。建议修改。
7 W8 s2 T* g) S7 O4 t  g4 X
' |6 ^, I4 n9 z5 U/ m! R  {$ g[size=12.0000pt]9. [size=12.0000pt]CPU中间不建议这样拉长线,建议修改。
. P: i4 b& X% B; X; [: Z
& Z; {# V4 f& Z' k4 _! \[size=12.0000pt]10. [size=12.0000pt]滤波电容靠近管脚摆放,不然起不到滤波效果。
0 i$ O* F6 ]  p. U2 G" |, U3 H; M  g$ y
& z3 c; g+ l  a0 o" q

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发表于 2018-11-20 16:10:36 | 显示全部楼层
[size=12.0000pt]11.[size=12.0000pt]这种大焊盘建议打上散热过孔。
, [; u! a1 p9 ?- n- E+ q+ e! h4 K  P( d3 w* f0 u! }
[size=12.0000pt]12.走线建议不要出现锐角。可以在画完板后加上泪滴。
' Q5 H9 @/ c0 }, u2 S9 m7 ~- O" w7 Z; q5 {& g9 q- m' ~, |* `
[size=12.0000pt]13.时钟线建议包地处理。
, C. ^7 u* N* S. s' H
( V/ i5 T/ w6 o# G) x' L[size=12.0000pt]14.由于没原理图,不知道电流多大。电源的处理建议参考经验值0.5mm的过孔过1A。表层的线是40mil过1A(表层递增加20,内层递增加40 。不是绝对值,通常做好1A的预留)。检查电源的过孔数量是否足够,线宽是否满足需要。
$ e" [0 O6 s3 |1 I' j' f6 e, O) w
" {5 I& q! \2 u3 y

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发表于 2018-11-20 18:59:13 | 显示全部楼层
谢谢分享AD 4层采集器 PCB论坛公益评审
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发表于 2019-1-22 15:43:24 | 显示全部楼层
要是每个都有个正确的示例,看看会更好
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发表于 2019-1-23 14:42:44 | 显示全部楼层
谢谢分享,学习了
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发表于 2019-1-23 20:38:49 | 显示全部楼层
学习学习,
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发表于 2019-3-28 13:54:03 | 显示全部楼层
时钟线包地处理有没有必要?间距足够应该就可以了
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发表于 2019-8-26 10:32:00 | 显示全部楼层
感谢分享,积累学习
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发表于 2020-11-26 16:14:17 | 显示全部楼层
谢谢分享,学习一下
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