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求助 | 打板回来调试,电路工作异常,大家帮忙分析一下这个电路图,能补救吗?

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发表于 2024-8-31 11:02:00 | 显示全部楼层 |阅读模式

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" v. J8 r% M6 S& C
点击上方名片关注了解更多. d3 P4 O- _, M( k; o( d
2 L; b( z1 b8 O: X% |
' l7 [& I6 j+ V; r- B0 S

, r1 M8 i" S' L8 F1 t9 C9 M大家好,我是王工。
/ @& W% k9 D. }! S% c4 C
/ P- Q2 x- o. o1 o" A5 k这是微信上一个兄弟找的我,说他电路调试时有问题,问我有没有可以解决的办法。下面是部分聊天截图。
0 b0 A- y7 f( |* Z, \

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# M6 C! l2 |- d, {4 @0 T
! t8 u' t- @* M) O- {通过交谈,我把他的需求梳理了一下:5 N5 a& e$ z4 K. U0 ]
设备有两组供电电源,一组是主电源,另一组是辅助电源。+ R0 V6 |, W# B
主电源和辅助电源同时供电,优先使用主电源,当主电源断电后,辅助电源无缝衔接给设备供电。4 P% ~4 @- _. R
然后呢,网上有一个推荐电路如下图:这个电路是怎么工作的呢?; t7 R* `3 S6 f

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$ `& U& c! s/ L1 y, `' M
电路分析:
( b  S( P. r2 [% K8 G) j1、当主电源Vin1为3.3V时,Q1的NMOS导通,然后Q3 PMOS的栅极被拉低, Q3 导通,Q2 MOS管关闭,外部电源Vin2断开,VOUT由Vin1进行供电。2、当主电源Vin1断开,Q1 NMOS截止,Q2 PMOS的栅极通过R1下拉,Q2导通,Q3 PMOS的栅极通过R2上拉,Q3截止。VOUT由外部电源Vin2供电。7 J& P7 l" p4 p1 B
通过分析看来,好像电路没什么问题,主备切换可行。但是在实际调试过程中发现主电源在下降的过程中,Q1和Q3不能及时断开,导致Q2只能通过体二极管导通,有0.5V的压降。Q3不能完全关断,而Q2就开始导通,外电源通过Q2、Q3形成通路,进一步阻止主电源的降低。相当于Q2永远不能导通,一直都是体二极管在导通。这就很严重了,相当于MOS管Q2一直没工作,整个电路就没啥用。
+ k% s- z# Z7 f问题出来了,那是什么原因导致的呢?其实就是主电源在下降的过程中Q1,Q3没有及时关断导致出现一系列问题,那是什么原因导致这两个管子关闭这么慢呢?两种可能:
7 y# p5 _" w" c1、主电源本身掉电比较慢,从而引起管子慢关断;
, q; p# }. ?- w7 f- L2、MOS管选型不对,Ciss寄生电容太大(感觉又不大可能,现在管子寄生电容都做的很小,应该影响不大)。4 `5 Q& |7 E7 ?. K- ?9 i! \
至于怎么优化电路,两种方法:5 `& n, D. d/ W% W- ?$ u
1、让主电源快速掉电;(怎么做到?)
$ ]  K- N+ B' a) H+ Z7 E2、让辅助电源慢速上电。(很难,而且不太好)7 g& J* Q, Y2 n" f% s/ W+ T
$ m: I6 R$ w( ]" q
这个例子也给大家提个醒:网上的电路不能随便拿来用,自己最好先验证一下再用。$ I; [- x# \# q, q( H+ Q, S
最后,这位兄弟板子已经打回来了,各位有比较好的优化建议,或者更好的电路分享,可以留言或加扫下方二维码,加微信告诉我,谢谢大家。) t& |6 h7 `: ?

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