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[作业已审核] 林若峰-4片DDR3菊花链PCB设计作业

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发表于 2022-11-6 21:00:43 | 显示全部楼层 |阅读模式

4片DDR走线的难度提升了不少，最开始用3层内层走完数据线之后发现地址线完全没办法横穿，导致整个走线重新推倒了重来了一次，下次在开始走线之前应该先规划一下再开始走线，包括哪组数据线走哪一层，需要多预先考虑一下，避免多次返工。

DQS和时钟线要与时钟线误差控制在250mil以内不大清楚如何实现

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