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Altium designer (AD 20) 请教关于内电层被过孔打断的问题

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发表于 2022-8-24 13:00:17 | 显示全部楼层 |阅读模式
请问AD软件中有没有检查内电层可能被过孔打断的规则？: T  o6 B7 b# W+ k# c+ r
比如内电层连接最窄处不能小于某个值？* S6 x- g& y; O% Q

' N. _5 |7 [1 P+ S0 f. D
; P6 Z/ ]( z* n/ e3 H4 s又或者可是使用多个规则的共同约束实现这种错误类型的检查？  F0 m2 w& m: i  m4 _6 d; v; c
* V; v7 o( E2 A$ t4 {
我现在遇到的问题是，内电层还连着一点点（不到 5mil），AD没有检查出来！
: h7 W& e3 p' C5 _7 ~7 q/ a6 q( o1 J. q; b
希望各位前辈能帮帮忙！谢谢各位前辈！, A% ]; k# x' ~9 Q5 I+ U4 w: f+ L
) b7 P, s5 P& Z' z! Q) e" |5 i
0 u$ x& d8 T4 v+ ?8 S) ]" r/ ^5 b
2 V) r$ G4 q# a0 E+ X9 @

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