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[PCB技术] Allegro在导入Logic原理图网表文件时出现.SVA报错的详细解决办法

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凡亿-彭老师 发表于 2022-1-7 17:10:23 | 显示全部楼层 |阅读模式 打印 上一主题 下一主题
allegro在导入网表文件时或者运行软件的时候出现如下截图报错,很多网友找不到解决方法,其实是可以根据下面俩种方法去解决这个问题的。
+08:00C423联盟网5075.png
第一种:
1、当在设计过程中出现这个问题或者是在刚打开这个某一些文件出现这个问题的时候,可以点击菜单栏命令Tools--Database Check”进行文件检测。
+08:00C423联盟网8866.png
2、点击之后弹出如下对画框,将其中所有方框中的勾全部都勾选上。再点击check 进行检测即可。
+08:00C423联盟网2197.png
第二种:
导致出现这个报错的还有一种诱因,就是版本文件不同。这个版本文件不同是指的:假如当前文件版本是16.6版本设计的,但是又用17.x版本进行设计,也会导出出现这个报错。所以在设计之前最好是检查一下文件版本,然后再进行设计。或者是电脑上的可以装多个版本的Allegro软件(安装多个版本的方法可以在论坛上面搜索参考)这样的话就可以很大程度上避免很多的一些没必要的报错。

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欧米盟 发表于 2022-1-8 16:26:49 | 显示全部楼层
好点评………………
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