Altium Designer PCB设计涉及到高压时，如何爬电距离进行规则约束设置？

嘻嘻哈哈123 · 发表于 2021-2-1 10:26:05

Altium designer pcb设计涉及到高压时，如何爬电距离进行规则约束设置？

答：两个导电部件之间,或一个导电部件与设备及易接触表面之间沿绝缘材料表面测量的最短空间距离。沿绝缘表面放电的距离即泄漏距离也称爬电距离，简称爬距。对最小爬电距离做出限制，是为了防止会在绝缘材料表面产生局部恶化传导路径的布线，这样的布线会使得电子在绝缘表面或附近放电。

游客，如果您要查看本帖隐藏内容请回复

本条问答已经录制视频教程，播放地址：https://www.fanyedu.com/course/20501.html

--------------------------------------------------------------
每天学习一个技巧，日积月累你也是专家！
使用前请您先阅读以下条款:
1、转载本站提供的资源请勿删除本说明文件。
2、分享技术文档源自凡亿教育技术验总结分享！
3、表述观点仅代表我方建议，不对直接引用造成损失负责！