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[作业已审核] 吴俊洪-8层DDR3 4片菊花链拓扑PCB作业

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发表于 2020-6-29 15:33:39 | 显示全部楼层 |阅读模式
本帖最后由 cesc 于 2020-7-6 09:57 编辑

请黄老师审阅

8_DDR3_FLYBY_FINISH.rar

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发表于 2020-6-30 12:10:32 | 显示全部楼层
顶………………
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发表于 2020-7-6 09:51:21 | 显示全部楼层
不同组的信号线之间尽量间距拉大一些,或者用地线进行隔离
+08:00C118联盟网7566..png
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发表于 2020-7-6 09:52:49 | 显示全部楼层
这种走线还可以均匀一些 +08:00C119联盟网2373..png
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发表于 2020-7-6 09:54:27 | 显示全部楼层
这种要就近打地过孔,不能直接铺铜连上了事 +08:00C121联盟网3136..png
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发表于 2020-7-6 09:55:09 | 显示全部楼层
过孔不要打在焊盘上
+08:00C121联盟网9255..png
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发表于 2020-7-6 09:56:54 | 显示全部楼层
铺铜走线直接挨着板边,太近了,routekeepin要比板框内缩20mil +08:00C122联盟网4152..png
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发表于 2020-7-6 09:57:06 | 显示全部楼层
其它没什么问题
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