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[已解答问题] 晶振、电容和1M电阻布局布线

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发表于 2016-10-23 19:10:11 | 显示全部楼层 |阅读模式
MCU时钟往往外接晶振、电容,有的会并一个1M电阻,PCB布局时怎么布局好?MCU出来是先晶振后电容好还是先电容后晶振好?还有1M的电阻放那个位置比较好?布线应该注意什么?
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发表于 2018-6-11 23:04:55 | 显示全部楼层

为什么需要“π”型滤波方式?我在百度和书上都没有找到这种的做法的依据,可不可以详细说明一下?或者有这方面的资料?

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对啊,为什么啊  详情 回复 发表于 2019-2-11 22:14
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发表于 2016-10-24 10:22:32 | 显示全部楼层
MCU出来直接晶振
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发表于 2016-10-24 19:15:18 | 显示全部楼层
怎么设计的,学习学习。
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QQ
发表于 2016-10-25 08:59:04 | 显示全部楼层
晶振是一个干扰源,本体表层及第二层禁止其他网络走线,并注意在晶体引脚及负载电容处多打地过孔。
晶振走线尽量短,晶振走线尽量不要打孔换层,走在和器件同面,并且采用“π”型滤波方式,如图所示。

图片1.png

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谢谢Kivy~~  详情 回复 发表于 2016-10-27 22:57
凡亿教育 课堂免费视频汇总:https://www.fanyedu.com
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发表于 2016-10-27 22:57:49 | 显示全部楼层
Kivy 发表于 2016-10-25 08:59
晶振是一个干扰源,本体表层及第二层禁止其他网络走线,并注意在晶体引脚及负载电容处多打地过孔。晶振走线 ...

谢谢Kivy~~
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发表于 2016-10-28 09:33:00 | 显示全部楼层
学习了,
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Gan

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发表于 2016-10-31 14:59:55 | 显示全部楼层
very good TQ
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发表于 2017-7-29 11:36:52 | 显示全部楼层
资料很好,强烈支持楼主,感谢分享!
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发表于 2017-7-29 12:14:33 | 显示全部楼层
真是难得给力的帖子啊。
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发表于 2017-8-2 09:03:39 | 显示全部楼层
支持一下,学习学习,谢谢分享
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